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流水線(pipeline)技術(shù)是指在程序執(zhí)行時(shí)多條指令重疊進(jìn)行操作的一種準(zhǔn)并行處理實(shí)現(xiàn)技術(shù)。流水線是Intel在486芯片中開始使用的。流水線的工作方式就像工業(yè)生產(chǎn)上的裝配流水線。在CPU中由5—6個(gè)不同功能的電路單元組成一條指令處理流水線,然后將一條X86指令分成5—6步后再由這些電路單元分別執(zhí)行,這樣就能實(shí)現(xiàn)在一個(gè)CPU時(shí)鐘周期完成一條指令,因此提高CPU的運(yùn)算速度。經(jīng)典奔騰每條整數(shù)流水線都分為四級(jí)流水,橋頭防靜電臺(tái)板線,即取指令、譯碼、執(zhí)行、寫回結(jié)果,浮點(diǎn)流水又分為八級(jí)流水。








對(duì)于流水線的瓶頸部分的處理主要在于減少流水段的處理時(shí)間。

實(shí)現(xiàn)的方法一般有兩種:
1、把瓶頸部分的流水線分拆,防靜電臺(tái)板線,以便任務(wù)可以充分流水處理。流水段的處理時(shí)間過長(zhǎng),中堂防靜電臺(tái)板線,一般是由于任務(wù)堵塞造成的,而任務(wù)的堵塞會(huì)導(dǎo)致流水線不能在同一個(gè)時(shí)鐘周期內(nèi)啟動(dòng)另一個(gè)操作,可以把流水段劃分,佛山防靜電臺(tái)板線,在各小流水段中間設(shè)置緩存寄存器,緩沖上一個(gè)流水段的任務(wù),使流水線充分流水。假如X流水段的處理時(shí)間為3T,可以把X流水段再細(xì)分成3小段,這樣,每小段的功能相同,但是處理時(shí)間已經(jīng)變成3T/3=T了。

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