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其他EFT干擾抑制措施

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以上這些對(duì)策措施主要是在EFT注入端口及外殼和接口上采取相應(yīng)的抑制措施。除了這些外部抑制措施，提高被測(cè)設(shè)備內(nèi)部電路的抗干擾能力也是非常必要的，此外主要針對(duì)EFT干擾抑制特點(diǎn)提出幾個(gè)設(shè)計(jì)要點(diǎn)：

1.對(duì)PCB引出的模擬信號(hào)傳輸端口建議數(shù)字化或采用平衡傳輸或變壓器隔離。

2.對(duì)PCB引出的數(shù)字信號(hào)建議采用光耦隔離或變壓器隔離或直接換光纖傳輸。

3.對(duì)模擬電路，對(duì)稱平衡放大器比單極性放大器具有更強(qiáng)的共模干擾抑制能力。

4.對(duì)數(shù)字電路，所有的未使用的輸入端口與地或電源連接，不可懸空。

5.對(duì)智能芯片，電平觸發(fā)比邊沿觸發(fā)抵抗脈沖干擾的能力強(qiáng)得多。

6.與外部連接的接口，帶選通功能的接口芯片比不帶的具有更強(qiáng)的抗干擾能力。

7.對(duì)有CPU的智能電路在軟件中加入抗干擾指令并采用“看門(mén)狗電路”是必要的。

8.任何時(shí)候都不要讓外部信號(hào)沒(méi)有經(jīng)過(guò)接口芯片隔離直接進(jìn)出CPU。

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電路設(shè)計(jì)1

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在內(nèi)部電路上加強(qiáng)防護(hù)措施：

對(duì)可能遭受直接傳導(dǎo)的靜電放電干擾的端口，可以在I/O接口處串接電阻或并聯(lián)二極管至正負(fù)電源端。

MOS管的輸入串接100KΩ電阻，輸出端串接1KΩ電阻，以限制放電電流量。

TTL管輸入端串接22-110Ω電阻，輸出端串接22-47Ω電阻。

模擬管輸入端串接100Ω-100KΩ，并且加并聯(lián)二極管，江門(mén)24V2A開(kāi)關(guān)電源，分流放電電流至電源正或負(fù)極，模擬管輸出端串接100Ω的電阻。在I/O信號(hào)線上安裝一個(gè)對(duì)地的電容能夠?qū)⒔涌陔娎|上感應(yīng)的靜電放電電流分流到機(jī)箱，避免流到電路上。

但這個(gè)電容也會(huì)將機(jī)殼上的電流分流到信號(hào)線上。為了避免這種情況的發(fā)生，可以在旁路電容與線路板之間安裝一只鐵氧磁體，24V2A開(kāi)關(guān)電源加工，增加流向線路板的路徑的阻抗。

需要注意的是，電容的耐壓一定要滿足要求。靜電放電的電壓可以高達(dá)數(shù)千伏。

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